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fpga工程师
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职位描述
Verilog HDL
岗位职责:
1、与算法工程师对接,负责Matlab/C++图像处理算法到FPGA的移植和优化验证;
2、与软件工程师对接,梳理嵌入式软件调用逻辑,根据需求实现算法模块的接口设计;
3、负责FPGA逻辑模块设计,RTL代码编写,仿真及上板调试;协同硬件工程师与嵌入式软件工程师完成软硬件联调;
4、负责FPGA模块相关设计文档的撰写及代码维护。
任职要求:
1、本科及以上学历,工作经验不限,通信工程、信号处理、微电子、计算机相关专业,获得英语4级证书;
2、熟悉Verilog HDL、C语言,熟悉基础的串行通讯协议,如I2C、SPI等;
3、熟悉并调试过DDR3、DDR4接口,熟悉DMA机制,对DMA的仲裁调度有一定的开发经验;
4、熟悉AXI协议,对AXI-Lite、AXI-Full和AXI-Stream协议有一定的开发经验;
5、熟悉常用的视频传输协议和图像处理算法,熟悉基础的图像滤波算法实现及高位宽数学运算实现,有过ISP、图像COMS Sensor开发经验优先考虑;
6、熟悉嵌入式系统,对ARM及外设有一定了解,具备良好的数字电路基础,有过FPGA和ARM联合开发经验优先考虑;
7、有良好的英语阅读能力及文档撰写能力,具备良好的沟通能力和团队协作能力;
工作地点
西丽街道深圳万科云城六期深圳国际创新谷6栋A座17楼
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