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芯片后端DFT(可测性设计)工程师

面议
  • 成都武侯区
  • 3-5年
  • 本科
  • 全职
  • 招1人

雇员点评标签

  • 工作环境好
  • 同事很nice
  • 人际关系好
  • 团队执行强
  • 氛围活跃
  • 交通便利
  • 准时发工资
  • 五险一金

职位描述

数字后端验证MentorSynopsysTCLPerlShell
岗位职责:
(一)DFT策略制定
1、根据芯片的功能、结构和测试需求,制定全面的DFT策略,包括确定测试模式、测试向量生成方法、扫描链结构等,以确保芯片在制造过程中和成品后的可测试性。
2、与前端设计团队和验证团队沟通协作,将DFT策略融入芯片的整体设计流程,确保DFT设计与芯片的功能设计和验证工作无缝衔接。
(二)扫描链插入与优化
1、负责扫描链的插入工作,根据DFT策略将芯片内部的寄存器连接成扫描链,以便在测试过程中能够对寄存器进行控制和观测。
2、对扫描链进行优化,包括调整扫描链的长度、结构和顺序,以提高测试效率、降低测试成本和减少测试时间。
(三)测试向量生成与验证
1、运用专业工具生成测试向量,确保测试向量能够覆盖芯片的各种故障模式,包括固定型故障、桥接故障等。
2、对生成的测试向量进行验证,通过模拟测试过程检查测试向量的有效性,确保测试向量能够准确检测出芯片中的故障。
(四)内置自测试(BIST)设计
1、进行内置自测试(BIST)电路的设计,包括设计BIST控制器、测试图案生成器和响应分析器等,使芯片能够在内部自动执行部分测试功能,减少对外部测试设备的依赖。
2、优化BIST电路的性能,提高BIST测试的准确性和效率,同时确保BIST电路与芯片的其他功能模块正常协同工作。

岗位要求:
(一)学历与专业
电子工程、微电子学或相关专业本科及以上学历。
(二)工作经验
具有三年以上芯片后端DFT工作经验,有丰富的芯片可测性设计和测试经验者优先。
(三)技能要求
1、熟练掌握DFT设计工具,如Mentor Graphics Tessent或Synopsys DFT Compiler等。
2、深入理解芯片的可测性设计原理,包括扫描测试、BIST等技术,能够独立制定和实施DFT策略。
3、熟悉芯片后端物理设计流程,了解物理设计规则对DFT电路的影响。
4、具备一定的脚本编写能力,如TCL、Perl或Shell脚本,用于自动化DFT设计流程和数据处理。


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奖金绩效

同薪资

工作地点

天府软件园-C12座17层

职位发布者

刘晗阳/HR

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